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axi4

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pulp-platform/axi

SystemVerilog

用于高性能片上通信的AXI SystemVerilog可综合IP模块与验证框架。

asic axi axi4
pulp-platform
pulp-platform 开发者
1.7k
373
1.7k
+1
排名 #3
9月11日
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chipsalliance/Cores-VeeR-EH1

SystemVerilog

VeeR EH1 core

ahb-lite asic-design axi4
chipsalliance
chipsalliance 开发者
969
247
590
+1
排名 #2
9月20日
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chipsalliance/Cores-VeeR-EL2

SystemVerilog

VeeR EL2处理器内核

ahb-lite asic-design axi4
chipsalliance
chipsalliance 开发者
341
106
1.4k
排名 #12
7月13日
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